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06/08/2016 #1


Pequeño problema en verilog
Sé perfectmente que este foro no es para pedir ayuda ni solicitar que les hagan a uno los trabajo... Resulta me dejaron el siguiente trabajo



Este es el codigo que hice para el decodificador de 3 entradas y de ocho salidas... cada salida va conectdada a una and que esta con conectada cada una con un CS (Es que no puedo subir foto)

module Lab_2(a,b,c,d);
input a,b,c;
output wire [7:0] d;
wire [2:0]e;
assign e= {a,b,c};
assign d=(e==3\'b000)?8\'b00000001:
(e==3\'b001)?8\'b00000010:
(e==3\'b010)?8\'b00000100:
(e==3\'b011)?8\'b00001000:
(e==3\'b100)?8\'b00010000:
(e==3\'b101)?8\'b00100000:
(e==3\'b110)?8\'b01000000:
8\'b10000000;
endmodule



module lab2(a,b,c,x,cs);
input a,b,c,cs;
wire[7:0]o;
wire[7:0]y;


output wire[7:0]x;
punto1 lab2 (.a(a),.b(b),.c(c),.d(o));
assign y=8*{cs};
assign x=y&o;
endmodule


Ahora me hace falta hacer otra instancia para hacer un circuito para encender un led en la fpga pero el problema es que me dice que la letra H se enciende cuando Yo=0 Y1=0 por ejemplo.... O sea me dicen dos entradas y en el deco tengo 3, estoy confundido.. ¿Alguien me podria ayudar? ...
06/08/2016 #2
Moderador general

Avatar de DOSMETROS

anmaogo dijo: Ver Mensaje
(Es que no puedo subir foto)
¿Cómo subo imágenes y archivos?
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